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clocked d-amp design
#1
THD , 1khz: 0.00044% - das is doch ne Ansage ! Confused

hier , zum lesen:
quelle
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#2
Machste nen Schaltplan draus?
 
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#3
jo, mal sehen....machst dann ein layout draus?

bzgl ripple compensation (die sollte ja irgendwie auch mit rein, aber ohne fpga):
hier noch der Artikel von Bruno : dig. control PWM amp
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#4
Grade mal überflogen...
Ist der hart mathematische Ansatz. Nicht ganz elegant aber wohl zielführend lachend

Was spricht gegen ein FPGA?
Pffffffffft. "Da entwich das Vakuum" - Heinrich Physik, 1857.
 
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#5
[Bild: 176_Unbenannt.PNG]

DAS ist interessant!
Und einfach zu steigern... Für einen simplen Counter mit Überlauf und Comparator sind auch locker 200MHz drin - und das bei nem popeligen Cyclone 3



das "expect" muss natürlich "except" heißen Rolleyes
Pffffffffft. "Da entwich das Vakuum" - Heinrich Physik, 1857.
 
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#6
Zitat:Original geschrieben von woody

Grade mal überflogen...
Ist der hart mathematische Ansatz. Nicht ganz elegant aber wohl zielführend lachend

Was spricht gegen ein FPGA?
der Aufwand Rolleyes
geht vmtl auch einfacher, analog..(oder auch nicht...)
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#7
Zitat:Original geschrieben von alfsch

jo, mal sehen....machst dann ein layout draus?

bzgl ripple compensation (die sollte ja irgendwie auch mit rein, aber ohne fpga):
hier noch der Artikel von Bruno : dig. control PWM amp

Jo, wenns in 50x50mm passt. Big Grin
 
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#8
beidseitig bestückt, 4 layer...klar Tongue
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#9
800kHz sind natürlich noch so eine Sache...
Da wird die Auswahl an brauchbaren Fets ganz schnell ganz klein lachend
Pffffffffft. "Da entwich das Vakuum" - Heinrich Physik, 1857.
 
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#10
..oder die mosfets werden sehr klein ! Tongue

nee, mit "machbaren" 200...300khz sollte es schon werkeln ...
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